電磁干擾的產(chǎn)生及PCB設(shè)計(jì)中的抑制方案

電磁兼容性(EMC)常是制約設(shè)備間匹配性和正常性能實(shí)現(xiàn)的重要因素,因此電磁兼容性設(shè)計(jì)也是航天器設(shè)計(jì)中要考慮的關(guān)鍵因素.文章主要介紹了電磁干擾的產(chǎn)生原因,并從合理布局與布線、電容的設(shè)計(jì)、邏輯電路的使用等方面論述了如何在印制電路板(PCB)設(shè)計(jì)過(guò)程中減少電磁干擾.

作 者： 潘宇倩 白東煒 PAN Yuqian BAl Dongwei   作者單位： 潘宇倩,PAN Yuqian(國(guó)防科技大學(xué)航天與材料工程學(xué)院,長(zhǎng)沙,410073;北京空間飛行器總體設(shè)計(jì)部,北京,100094)

白東煒,BAl Dongwei(北京空間飛行器總體設(shè)計(jì)部,北京,100094) 

刊 名： 航天器工程  ISTIC 英文刊名： SPACECRAFT ENGINEERING  年，卷(期)： 2007 16(3)  分類號(hào)： V41  關(guān)鍵詞： 電磁干擾   PCB設(shè)計(jì)   電磁兼容性  

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